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Image: B25667-A2157-A175 B25667-A2157-A175 EPCOS Inc phasecap
Image: B25667-A3337-A375 B25667-A3337-A375 EPCOS Inc phasecap
Image: B25667-A5966-A175 B25667-A5966-A175 EPCOS Inc phasecap
Image: B25667-A2207-A175 B25667-A2207-A175 EPCOS Inc phasecap
Image: B25667-A3107-A175 B25667-A3107-A175 EPCOS Inc phasecap
Image: B25667-A3127-A375 B25667-A3127-A375 EPCOS Inc phasecap
Image: B25667-A3147-A175 B25667-A3147-A175 EPCOS Inc phasecap
Image: B25667-A3167-A175 B25667-A3167-A175 EPCOS Inc phasecap
Image: DF150AA120 DF150AA120 SanRex Corporation diode(three phases bridge type)
Image: DF150AA160 DF150AA160 SanRex Corporation diode(three phases bridge type)
Image: SH7137_09 SH7137_09 Renata output of complementary pairs of pwm signals in three phases
Image: NJU7333 NJU7333 New Japan Radio single-phasedc brushless motor driver IC
Image: NJU7333R NJU7333R New Japan Radio single-phasedc brushless motor driver IC
Image: B25667 B25667 Philips Semiconductors mkk AC capacitors phasecap⑩ power factor correction and filtering
Image: RFFC506x RFFC506x RF Micro Devices 无源元器件 RF 混频器 the rffc5061 and rffc5062 are re-configurable frequency conversion deviceswith integrated fractional-N phased locked loop (pll) synthesizer
Image: RFFC5071 RFFC5071 RF Micro Devices 无源元器件 RF 混频器 the rffc5071 and rffc5072 are re-configurable frequency conversion devices with integrated fractional-N phased locked loop (pll) synthesizer,
Image: RFFC5072 RFFC5072 RF Micro Devices 无源元器件 RF 混频器 the rffc5071 and rffc5072 are re-configurable frequency conversion devices with integrated fractional-N phased locked loop (pll) synthesizer
Image: LMX2615-SP LMX2615-SP Texas Instruments lmx2615-SP space grade 40 mhz to 15 ghz Wideband synthesizer w phasesynch and JE datasheet
Image: PLMX2615CV2 PLMX2615CV2 Texas Instruments lmx2615-SP space grade 40 mhz to 15 ghz Wideband synthesizer w phasesynch and JE datasheet
Image: MC100EL38 MC100EL38 ON Semiconductor 集成电路 时钟/计时 - 专用 MC100el38 是一款低歪曲率 2 分频、4/6 分频时钟生成芯片进行分频，明确适用于低歪曲率时钟生成应用。内部分频器互相同步，因此公共输出边全部精确对齐。该器件可由差分或单端 ecl 驱动，如果使用正向电源，则由 Pecl 输入信号驱动。仅为此器件提供 vbb 引脚，即内部产生的供应电压。对于单端输入情况，未使用的差分输入将作为开关参考电压联接 vbb。vbb 还可将 AC 耦合输入重偏置。使用时，通过 0.01 F 电容器对 vbb 和 vcc 进行去耦合，并将源或汲电流限制为 0.5 mA。不使用时，vbb 应保持开路。公共启用 (enbar) 是同步的，因此内部分频器仅在内部时钟已在低电平状态时启用/禁用。这样会避免当设备启用/禁用时在内部时钟上产生短时钟脉冲，这种情况可能发生在异步控制中。内部矮脉冲可能导致内部分频器级之间的同步丢失。内部启用触发器在输入时钟的下降边进行计时，因此，所有相关规格限制都参考到时钟输入的负边。每当 2 分频 4/6 输出分频均从低电平转换为高电平时，phase_out 输出都将进入高电平一个时钟周期。此输出可实现系统内的时钟同步。启动时，内部触发器将达到随机状态；因此，对于使用多个 el38 的系统来说，必须断定主时钟重置 (MR) 输入以确保同步。对于仅使用一个 el38 的系统，不需要作为内部分频器设计运行的 MR 引脚将确保同步。

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